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VLSI測試和可測試性設(shè)計.pdf

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VLSI測試和可測試性設(shè)計 ，VLSI測試和可測試性設(shè)計。
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VLSI測試和可測試性設(shè)計 EEHQU 22692477（O） 13600785246 edac@hqu.edu 2006-5-7內(nèi)容
第一部分:測試?yán)碚摶A(chǔ) 數(shù)字系統(tǒng)測試發(fā)展概況 VLSI測試過程和設(shè)備 測試經(jīng)濟(jì)學(xué)和產(chǎn)品質(zhì)量 故障模型
第二部分:測試矢量生成---ATPG 邏輯和故障模擬 可測試性測量 組合電路ATPG 時序電路ATPG 存儲器測試 IDDQ測試
第三部分:可測試性設(shè)計（DFT） 掃描測試 BIST 邊界掃描測試 模擬測試總線 2006-5-7
第一部分測試?yán)碚摶A(chǔ) 1.1數(shù)字系統(tǒng)測試發(fā)展概況 數(shù)字系統(tǒng)的測試是一個不缺少的重要環(huán)節(jié)。
系統(tǒng)測試的核心問題是確定施加什么樣的激勵，可以使故障激活 （既使故障能夠反映出來），同時能夠在可及端測量出來。
因此 還要確定在什么地方施加機理，在什么地方進(jìn)行測量。
最初的系統(tǒng)測試主要采用功能測試，如1953年Eckert所采用的 BINCA計算機就是用兩個相同的處理器同步進(jìn)行工作，并隨時進(jìn) 行比較，看其是否有相同的結(jié)果來判斷是否有故障。
生成測試程序 施加激勵 測試儀 被測電路 觀察響應(yīng) 測試結(jié)果 2006-5-7


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